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nand 存储原理致态TiPlus7100成功的奥义：长江存储晶栈Xtacking架构解析

发布时间 : 2024-11-24

作者 : 小编

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致态TiPlus7100成功的奥义：长江存储晶栈Xtacking架构解析

今年秋季，Intel和AMD最新平台发售，固态硬盘也全面开启PCIe Gen4时代。11月日国内存储品牌致态发布了重量级的PCIe Gen4新品致态TiPlus7100，该产品最大的亮点就是采用YMTC长江存储最新的晶栈?Xtacking?3.0架构NAND，最高连续读写性能达到了7000MB/s和6000MB/s，堪称是DRAMLess产品的绝地反击。

为何晶栈?Xtacking3.0?架构有如此亮眼的表现？在讨论Xtacking之前，我们先简单了解一下固态硬盘核心组件——NAND FLASH的内部结构。

01 从2D NAND到3D NAND

NAND的容量大小取决于晶圆上存储阵列Array中可存放最小存储单元Cell的数量。对于早期的Planar NAND平面NAND（也叫2D NAND）来说，为了进一步提升存储容量和降低成本，就需要更先进的制程工艺，但制程工艺越高，晶圆的氧化层越薄，性能和可靠性都会出现下降，因此3D NAND开始成为主流。

所谓3D NAND就是相对于Planar NAND而言的，在晶圆上采用多层堆叠设计，如果把Planar NAND比喻成平房，那么3D NAND就是高楼大厦，提升NAND的容量只需堆叠更多层数的Array，使得容量、性能和可靠性都得到了保证。目前的3D TLC NAND已经到达100层以上，单颗NAND更是实现了1TB的容量。

02 NAND的架构

虽然3D NAND的概念比较容易理解，但落实到生产层面就不是单纯的叠层这么简单，这就涉及到NAND架构的问题。从全球主流的全球主流存储厂商出品的NAND横截面图可知，三星、铠侠和西部数据采用常规的并列式架构，将控制数据读取、写入的外围CMOS线路放在Array下方，只是技术层面有所不同。

例如三星V-NAND系列NAND，采用一次性加工、内存孔（Memory Hole）HARC蚀刻技术，铠侠/西部数据BiCS NAND则采用两个48层堆叠。并列式架构的优势是加工难度相对较低，但对于晶圆蚀刻设备和技术有着较高的要求。

Intel/Micron以及SK海力士则另辟蹊径采用了CuA（CMOS under Array）架构，这是一种将CMOS线路放置在Array以下的加工方式，从而增大了Array的面积。CuA架构的优势是能扩大单个芯片的存储密度，但同样存在制造工艺难度较高的问题。

而YMTC长江存储采用的是独家的?Xtacking?3.0架构，将CMOS线路用一种不同于存储核心Array的晶圆制造而成，分别通过Bonding工艺进行贴合，在指甲盖大小的面积的晶圆上通过数十亿根金属通道，将CMOS和Array进行连接，合二为一。

03 长江存储Xtacking?架构解析

从原理看，YMTC长江存储的晶栈?Xtacking?架构是两片独立的晶圆上，分别加工外围电路和存储单元，在逻辑工艺上有着更多的自主选择性，从而让NAND获取更多的I/O通道、更高的接口速度，例如最新的晶栈?Xtacking?3.0架构NAND具备四闪存通道和高达2400MT/s的接口带宽，这也是致态TiPlus7100即使采用DRAMLess方案，也能实现7000MB/s和6000MB/s的核心要义。

3D NAND颗粒最重要的发展方向是存储密度的优化。在传统3D NAND架构中，外围CMOS电路约占芯片面积20~30%，而Xtacking?技术创新的将外围电路置于存储单元之上，从而实现比传统3D NAND更高的存储密度，芯片面积可减少约25%，同等面积基础上，Xtacking?架构能够提供更多的存储单元，成为长江存储旗下致态品牌固态硬盘足容量的保证。

除了容量、性能和成本，NAND颗粒的良品率和出货量也是市场竞争的重要一环。自Xtacking?2.0技术诞生以来，长江存储NAND的良品率大幅度跃升，充分满足长江存储自有存储产品和客户供货的需求。除此之外，Xtacking?工艺存储单元和外围CMOS线路独立加工的特性，可以实现并行和模组化的灵活生产，较于传统结构产品研发周期可缩短三个月，生产周期可缩短20%，使得长江存储NAND的出货量也得到大幅提升。

作为长江存储核心技术品牌，晶栈Xtacking?代表着长江存储在3D NAND存储技术领域的创新进取和卓越贡献。经过9年技术积累和4年技术验证，晶栈Xtacking?架构NAND不仅性能和可靠性均达到了国际水准，更拥有较高的存储密度和更灵活的开发周期，这也是致态品牌SSD产品成功的奥义所在。

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NAND Flash浮栅晶体管的结构、工作原理及其局限性

作为最为常见的存储芯片，NAND Flash已经被广泛采用，特别是在消费类电子产品当中，因此，在其存储密度不断提升的同时，成本也越来越敏感。由于Flash闪存的成本取决于其芯片面积，如果可以在同一区域存储更多数据，Flash将更具成本效益。NAND闪存主要有三种类型：Single Level Cell（SLC），Multi Level Cell（MLC）和Triple Level Cell（TLC）。顾名思义，TLC Flash在与MLC相同的区域中存储的数据更多，同理，MLC存储的数据多于SLC。另一种类型的NAND闪存称为3D NAND或V-NAND（垂直NAND），其通过在同一晶片上垂直堆叠多层存储器单元，这种类型的闪存实现了更大的密度。 浮栅晶体管 闪存将信息存储在由浮栅晶体管组成的存储单元中。为了更好地理解不同类型的NAND闪存，让我们来看看浮栅晶体管的结构、工作原理及其局限性。浮栅晶体管或浮栅MOSFET（FGMOS）非常类似于常规MOSFET，区别在于它在栅极和沟道之间具有额外的电绝缘浮栅。由于浮栅是电隔离的，所以即使在去除电压之后，到达栅极的电子也会被捕获。这就是闪存非易失性的原理所在。与具有固定阈值电压的常规MOSFET不同，FGMOS的阈值电压取决于存储在浮栅中的电荷量，电荷越多，阈值电压越高。与常规MOSFET类似，当施加到控制栅极的电压高于阈值电压时，FGMOS开始导通。因此，通过测量其阈值电压并将其与固定电压电平进行比较来识别存储在FGMOS中的信息，被称为闪存中的读操作。可以使用两种方法将电子放置在浮动栅极中：Fowler-Nordheim隧穿或热载流子注入。对于Fowler-Nordheim隧穿，在带负电的源极和带正电的控制栅极之间施加强电场。这使得来自源极的电子隧穿穿过薄氧化层并到达浮栅。隧穿所需的电压取决于隧道氧化层的厚度。利用热载流子注入，高电流通过沟道，为电子提供足够的能量以穿过氧化物层并到达浮动栅极。通过在控制栅极上施加强负电压并在源极和漏极端子上施加强正电压，使用福勒 - 诺德海姆隧道效应可以从浮栅移除电子。这将导致被捕获的电子通过薄氧化层回到隧道。在闪存中，将电子放置在浮动栅极中被认为是编程/写入操作，去除电子被认为是擦除操作。隧道工艺有一个主要缺点：它会逐渐损坏氧化层。这被称为闪存中的磨损。每次对单元进行编程或擦除时，一些电子都会卡在氧化层中，从而磨损氧化层。一旦氧化层达到不再能够在编程和擦除状态之间进行可靠性区分的点，则该单元被认为是坏的。由于读取操作不需要隧穿，因此它们不会将单元磨掉。这就是为什么闪存的寿命表示为它可以支持的编程/擦除（P / E）周期的数量。SLC闪存 在SLC闪存中，每个存储单元仅存储一位信息：逻辑0或逻辑1.单元的阈值电压与单个电压电平进行比较，如果电压高于电平，则该位被视为逻辑0。反之则为逻辑1。由于只有两个级别，因此两个级别之间的电压裕度可能非常高。这使得读取单元格更容易，更快捷。原始误码率（RBER）也很低，因为由于较大的电压余量，在读取操作期间泄漏或干扰的影响较小。低RBER还减少了给定数据块所需的ECC位数。大电压裕量的另一个优点是磨损的影响相对较小，因为微小的电荷泄漏具有相对较低的影响。每个逻辑电平的更宽分布有助于以更低的电压对单元进行编程或擦除，这进一步增加了单元的耐久性，进而增加了寿命，即P / E循环的数量。同时也有一个缺点，就是与在相同芯片区域中存储更多数据的其他类型的Flash相比，每个单元的成本更高。SLC闪存通常用于对成本不敏感且需要高可靠性和耐用性的场合，例如需要大量P / E循环次数的工业和企业应用。MLC闪存 在MLC闪存中，每个存储器单元存储两位信息，即00,01,10和11，在这种情况下，阈值电压与三个电平进行比较（总共4个电压带）。通过更多级别进行比较，读取操作需要更加精确，与SLC Flash相比，读取速度更慢。由于较低的电压余量，原始误码率（RBER）也相对较高，并且给定数据块需要更多的ECC比特。现在磨损的影响更为显着，因为与SLC闪存相比，任何电荷泄漏都会产生更大的相对影响，从而减少寿命（P / E循环次数）。由于需要仔细编程以将电荷存储在每个逻辑电平所需的紧密窗口内，因此编程操作也要慢得多。其主要优点是每比特成本更低，比SLC闪存低2~4倍。MLC闪存通常用于成本更敏感的应用，例如消费电子或游戏系统，其性能、可靠性和耐用性不是那么关键，并且所需的P / E循环次数相对较低。企业级多单元（eMLC）闪存 MLC闪存的低可靠性和耐用性使它们不适合企业应用，而低成本是一个驱动因素。为了带来更低成本的优势，闪存制造商创建了一种优化级别的MLC闪存，具有更高的可靠性和耐用性，称为eMLC。eMLC中的数据密度通常会降低，从而提供更好的电压余量以提高可靠性。较慢的擦除和编程循环通常用于减少磨损的影响并提高耐用性。还有许多其他技术可以提高eMLC的可靠性和耐用性，这些技术因制造商而异。TLC闪存 在TLC Flash中，每个存储器单元存储3位信息。现在将阈值电压与7个电平（总共8个电压带）进行比较。与SLC Flash相比，TLC的读取操作需要高度精确且速度慢。原始误码率也很高，增加了对给定数据块的更多ECC位的需求。磨损的影响也被放大，大大减少了寿命（P / E循环次数）。编程操作也较慢，因为电压需要精确以将电荷存储在每个逻辑电平所需的窗口内。 TLC的优势在于每比特的最低成本，与SLC或MLC闪存相比要低得多。TLC闪存用于高成本敏感型应用，对P / E循环的需求较少，例如消费类应用。SLC，MLC，eMLC和TLC的比较 表1给出了假设类似光刻工艺的不同类型闪存的主要参数的比较。这些值仅表示比较性能，并且就特定存储器产品而言可能不准确。

表1：每种不同类型Flash的主要参数的比较。 * ECC位数取决于制程节点; 较小的制程节点需要更多的ECC位。 3D NAND Flash 上面讨论的所有不同的闪存都是二维的，意味着存储单元仅布置在芯片的XY平面中。使用2D闪存技术，在同一晶圆中实现更高密度的唯一方法是缩小制程工艺节点。其缺点是，对于较小的节点，NAND闪存中的错误更为频繁。另外，可以使用的最小制程工艺节点存在限制。为了提高存储密度，制造商开发了3D NAND或V-NAND（垂直NAND）技术，该技术将Z平面中的存储单元堆叠在同一晶圆上。以这种方式构建有助于为相同的芯片区域实现高位密度。在3D NAND闪存中，存储器单元作为垂直串连接而不是2D NAND中的水平串。第一批3D Flash产品有24层。随着该技术的进步，已经制造出32,48,64甚至96层3D闪存。3D闪存的优势在于同一区域中的存储单元数量明显更多。这也使制造商能够使用更大的制程工艺节点来制造更可靠的闪存。 3D Flash的另一个主要技术转变是使用电荷阱Flash而不是浮栅晶体管。除了用氮化硅膜代替浮栅之外，电荷阱在结构上类似于FGMOS。注意，由于大规模制造的困难，电荷阱在市场上没有被广泛使用。由于难以制造浮栅晶体管的垂直串以及电荷阱的其他固有优点，已经采用电荷阱技术用于3D闪存。与FGMOS相比，基于电荷阱的存储器有许多优点。可以在较低电压下编程和擦除基于电荷阱的存储器，从而提高耐用性。由于捕获层（氮化物）是绝缘层，电荷不会泄漏，从而提高了可靠性。由于电荷不会从电荷阱的一侧流到另一侧，因此可以在同一阱层存储多于一位的电荷。赛普拉斯（前Spansion）在NOR闪存中有效地利用了这种功能，称为MirrorBit技术，将两位数据存储在一个类似于MLC闪存的单个存储单元中。未来的趋势 所有主要的闪存制造商都积极致力于开发不同的方法，以降低每比特闪存的成本，同时正在积极研究增加3D NAND Flash中垂直层的数量。虽然15nm似乎是目前NAND闪存中最小的成功节点，但Flash的光刻节点的缩小仍在继续。将MLC和TLC技术与3D NAND闪存相结合的方法也正在积极探索当中，许多制造商已经看到了成功的曙光。随着新技术的出现，我们可能很快就会看到存储单元可以存储一个字节的数据和垂直层，达到256层，甚至更高

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