慧荣科技推出适用于 AI 智能手机、边缘计算和汽车应用的UFS 40 主控芯片

2024年3月13日--全球NAND闪存主控芯片领导厂商慧荣科技(NasdaqGS:SIMO)，今日宣布推出UFS（通用闪存存储）4.0主控芯片SM2756。作为业界使用最广泛的UFS主控芯片解决方案系列的旗舰产品，可满足人工智能手机和其他高性能应用（包括汽车和边缘运算）不断增长的需求。同时还新增了第二代SM2753UFS3.1主控芯片，以扩展其产品组合，支持从UFS4.0至UFS2.2标准。慧荣科技UFS产品系列为旗舰、主流和高性价比手机及其他移动计算设备提供高性能、低功耗的嵌入式存储，支持最广泛的NAND闪存，包括下一代高速3DTLC 和QLCNAND。

最新的SM2756UFS 4.0 主控芯片解决方案是全球最先进的主控芯片，基于领先的6纳米EUV技术，采用MIPIM-PHY 低功耗架构，提供高性能和电源效率的最佳平衡，满足现今高端AI移动设备的全天候计算需求。SM2756实现4,300MB/s 以上的循序读取性能和4,000MB/s 以上的循序写入速度，支持最广泛的3DTLC 和QLCNAND 闪存，容量高达2TB。

全新第二代SM2753UFS 3.1 主控芯片解决方案，采用高速串行链路的MIPIM-PHY HS-Gear4x2-Lane标准和SCSI体系结构模型(SAM)，实现前所未有的性能。继SM2754UFS3 主控芯片取得成功后，SM2753以单通道的设计特点，采用新一代3DTLC 和QLCNAND，提供2150MB/s 的循序读取性能和1900MB/s 的循序写入性能，满足当前手机、物联网和汽车应用中不断增长的UFS3.0市场需求。

慧荣科技最新UFS主控芯片解决方案搭载先进的LDPCECC 技术，具备SRAM数据错误检测和校正功能，增强数据可靠性、提高性能并降低功耗。最新UFS主控芯片解决方案支持最广泛的NAND，包括所有领先闪存制造商最新的3DTLC 和QLCNAND 产品。

慧荣科技终端和车用存储业务高级副总段喜亭表示：“采用6纳米EUV制程的SM2756满足最新的高端智能手机对高性能、高容量和低功耗NAND存储的需求，符合下一代AI功能和应用。”他指出：“最新的单通道SM2753能够使我们通过更具成本效益、高性能和低功耗的主控芯片，在扩大且不断增长的UFS3.0市场中保持领先地位。”

UFS4.0SM2756：

符合 JEDEC UFS 4.0 标准并支持 HS-Gear-5 x 2-Lane、MPHY 5.0 和 UniPro 2.0 标准

双通道 NAND 闪存主控芯片，并支持 1.8V/1.2V I/O 操作和 Toggle DDR 5.1 / ONFI 5.1 NAND

LDPC ECC 引擎，支持低功耗解码模式，通过软信息进行高纠错功能

循序读取 / 写入性能：4300MB/s / 4000MB/s

2024 年中批量生产

UFS3.1 SM2753

符合 JEDEC UFS 3.1 标准并支持 HS-Gear-4 双通道、MPHY 4.1 和 UniPro 1.8 标准

单通道 NAND 闪存主控芯片，支持 1.8V/1.2V I/O 操作和 Toggle DDR 5.1 / ONFI 5.1 NAND

LDPC ECC 引擎，支持低功耗解码模式，通过软信息进行高纠错功能。

循序读取 / 写入性能：2150MB/s / 1900MB/s

目前进入批量生产

慧荣科技将于3月20日在深圳举办的CFMS| MemoryS 2024峰会中展示最新的UFS控制芯片，以及最新的消费级和企业级SSD解决方案，同时也受邀于峰会主论坛中进行演讲。

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UFS深入浅出 第二章 UFS结构 第四节 UFS分块图解

Section 4 UFS block diagram

第四节 UFS分块图解

In this section, we will have a high-level view of UFS block diagram. Meanwhile we will also have a data flow overview in-between each block. Detail of each block will be covered in the following chapter.

在这一节里，我们会比较笼统的看一下UFS的分块图解。同时，我们也会看一些各个块之间的数据流动。每个块的具体细节会在接下来的章节里面涵盖。

On left of the diagram is Host, is composed by SoC, RAM and UFS Host Controller. The Host here does not simply mean UFS host, but the host of the whole system. While the UFS device is on the right side, which contains UFS Device Controller with embedded SRAM and standalone NAND Flash media.

在分解图的左边是Host，由SoC，RAM和UFS 主机控制器组成。这里的主机不是简单的指UFS 主机，而是整个系统的主机。UFS器件则在右边，包括了UFS 器件控制器以及内嵌的SRAM和独立的NAND Flash 闪存。

If you look into detail of UFS Host Controller and UFS Device Controller, you will find they are quite similar like each other with the same internal layer structures. The difference is that there is a UFS Host Controller Interface called UFS HCI in Host Diagram to communicate with Host SoC, while UFS device controller has got a NAND interface to connect with NAND in which Logic Unit and Registers physically reside. The same part in both sides is defined in the JEDEC UFS specification (latest one is JESD220F UFS4.0). JEDEC also has a HCI Specification (latest one is JESD223E UFSHCI4.0) for UFS Host Controller Interface. Regarding NAND interface, JEDEC absorbs ONFI (Open NAND Flash Interface), and this part will be covered in the article NAND Step by Step.

如果你仔细看UFS 主机控制器和UFS 器件控制器，你会发现他们彼此非常相像，都有着一样的内部层结构。不同的地方是UFS 主机控制器里面有一个叫做UFS HCI的UFS 主机控制器接口与主机SoC通讯。而UFS 器件控制器则有一个NAND接口与保存逻辑单元和寄存器的NAND 闪存通讯。两边相同的地方是在JEDEC UFS规范（最新的是JESD220F UFS4.0）。JEDEC还有一个给UFS 主机控制器接口的HCI规范（最新的是JESD3F UFSHCI4.0）

Usually in a traditional small system, there will be a CPU, RAM, and Disk. When we take a full picture of this diagram, the SoC (System on Chip) here acts as CPU in embedded system, RAM here refers volatile Dynamic RAM memory normally，either DDR RAM or LPDDR (Low Power DDR) RAM，for high-speed code or data access. Disk here is our leading role UFS device, which is a non-volatile memory to store the code and data without power supply. Please take a note that, Disk here is not an accurate name. Disk originally refers to Hard Disk Drive (aka HDD) which uses magnetic material for data non-volatile storage. Now we use this terminology simply for all non-volatile memory for easy understanding.

通常在一个传统的小型系统里面会有CPU，RAM和Disk。当我们整体来看分解图的时候，SoC（片上系统）在嵌入式系统里面扮演了CPU的角色。RAM这里通常是指易失的动态RAM存储器，可以是DDD RAM或者是LPDDR（低功耗DDR）RAM，主要是为了高速代码或者数据的访问。这里的Disk是我们的主角UFS器件，不需要电的非易失存储器。请注意这里的Disk不是一个准确的名字。Disk原本指的是为了数据的非易失存储而使用磁存储介质的硬盘驱动器（也叫HDD）。为了便于理解，现在我们用这个术语简单指代所有非易失存储器。

If we zoom in to focus only on UFS device side, the internal SoC （Yes, there is one SoC inside UFS device controller as well, invisible in this Diagram）of UFS Device controller will be CPU, controller internal SRAM will act as volatile RAM, and NAND flash is non-volatile Disk. Since in this article, we illustrate UFS protocol only, hence we will not go deeper into UFS device small system.

如果我们放大聚焦在UFS器件这边，UFS器件控制器里面的 SoC (是的，在UFS器件控制器里面也有SoC，这个图解里面不可见) 是CPU，控制器内嵌的SRAM是易失的RAM，而NAND闪存就是非易失的Disk。因为这篇文章我们只解释UFS协议，所以我们不会深入探究UFS器件的小系统。

Back to the small system SoC, DRAM, UFS, the main function of Flash is to store data since it is non-volatile memory and could keep data inside without power supply. But in order to load and save data into the NAND Flash, Host SoC need go all the way down through each layer of the UFS host Controller to the physical signals and goes up back through the correlative layers of UFS Device Controller to communicate with NAND Flash. This is the way that we use NAND Flash to save data, the opposite direction is load data.

回到SoC，DRAM和UFS的小系统，Flash的主要功能是存储数据，因为它是非易失存储器，可以在没有电供应的情况下保持数据。但是为了提取和保存数据，主机SoC需要一路向下穿过UFS主机控制器的每一层直到物理信号，然后再往上穿过相对应的UFS器件控制器的每一层去和NAND闪存通讯。这个是我们用NAND闪存存数数据的方式，相反的方向则是提取数据的方向。

We could also use dot line with arrow to see how they communicate with each other logically. On the top is the pair of Host SoC and NAND Flash for read and write operation. In the very beginning, Host SoC do access NAND Flash directly, but limitation is quite obvious. NAND 8-bit parallel I/O is not good to increase data rate for long distance transmission. NAND is born with bit errors for cost effective higher density, hence ECC (Error Correction Code), BBM (Bad Block Management) which bring extra burden for SoC. It does not count WL（wear-leveling）for overcoming limited NAND Flash P/E(Program/Erase) characteristic and FTL (File Transfer Layer) of easily use NAND Flash which need be access by pages but not bit. This is the reason why NAND controller and complex protocol needed for higher and higher data rate.

我们还可以给每一层用虚线箭头来展示逻辑上它们是怎么互相联系的。在最上面是读写操作的一对，主机SoC和NAND闪存。在最开始，主机SoC确实是直接访问NAND的，但是局限性也非常明显。NAND的8比特并行I/O不利于在长距离传输提高数据传输率。NAND天生就是为了更高容量节省成本而有比特错误，所以ECC（错误纠正码），BBM（坏块管理）会给SoC额外的负担。这个还没算为了克服有限的NAND闪存的P/E（编程/擦除）特性而使用的WL (磨损均衡)，以及为了方便管理NAND闪存这种使用页而不是比特访问而使用的FTL（文件转换层）。这个也是为了越来越高的速度需要使用NAND控制器以及复杂的协议的原因。

UCS (UFS Command Set) block use CDB (Command Descriptor block) for communication. CDB is defined by SCSI specification which implement not only read/write command but also other functional commands.

UCS（UFS指令集）模块用CDB（命令描述符块）来做通讯。CDB是SCSI协议定义的用来实现读写命令以及其它功能命令。

These commands CDB are embedded in in the next lower UTP (UFS transport Protocol) layer‘s UPIU (UFS Protocol Information Unit) Frame. Besides the communication to the peer layer, UPIU is also used internally by Task Manager block and Device Manager block.

这些命令CDB会嵌入到下面低一层的UTP（UFS传输层）的UPIU（UFS协议信息单元）帧里面。除了用于与对面对应层的通讯，UPIU也被用于内部的任务管理块和器件管理块。

Go deeper to UIC (UFS InterConnect) layer, UniPro is a software stack to hand so called credit-based flow control data transmission. PDU (Protocol data Unit) is the common name for the data packet in UniPro, each sub layer has its specific PDU name. UPIU from upper UTP layer will be divided here to fit for the PDU format. Device Manger block could skip UTP layer to access directly the DME (Device Manager Entity) in UniPro. This is like the internal employee private path for better control low level configuration.

在深一点去到UIC层, UniPro是一个软件协议栈用于处理被称为基于信用的流控数据传输。PDU (协议数据单元) 是UniPro里数据包的通用名字，每一个子层都有各自的专用PDU命名。从上面UTP层来的包在这里会被拆分来适配PDU格式。器件管理块能够越过UTP层直接访问UniPro里的DME（器件管理实体）。这个就像是内部员工的私人通道来更好地控制底层配置。

M-PHY in the UIC will finally encoded sending data or decoded receiving data into symbols and turn it to or from physical signals in the lane. M-PHY use 8b/10 line encoding to turns 8bit data into 10bit symbol for both High-Speed and Low-Speed. Regarding binary encoding，M-PHY for UFS use PWM (Pulse Width Modulation) for low Speed, while NRZ (Non Returned to Zero) for High Speed.

UIC里的M-PHY最终会把发送数据编码或者把接收数据编码成字符，然后转化成通道上的物理信号。高速或者低速M-PHY都使用8b/10b的线路编码把8比特字节转换成10比特的字符。而二进制编码，UFS的M-PHY的低速使用PWM（脉宽调制），高速则使用NRZ（非归零）。

The access point of in-between each diagram block is called SAP (Service Access Point), this could be thought of as logical API (Application Programming Interface).

在各个块之间的访问点被叫做SAP（服务访问点），这个可以被想象成为逻辑API（应用编程接口）。

SoC will utilize the system RAM to maintain the Task Manager request list and Command Transfer request list. These will notify UFS host controller for dispatching instructions by doorbell register which reside in UFS HCI. The name doorbell is quite vivid as if someone is knocking your door to tell you, hey, the tasks and commands are waiting for you to execute them. UFS device controller also maintains the task and command queue in its internal SRAM which is not defined in UFS specification and should be implemented by UFS device vendors.

SoC会使用系统RAM来维护任务管理请求列表和命令传输请求列表。这个会通过UFS HCI里面的门铃寄存器来通知UFS主机控制器分发指令。门铃寄存器这个名字非常生动，好像是有人正在敲门告诉你，嘿，任务和命令已经准备好等你执行了。UFS器件控制器同样在它内部的SRAM维护了任务和命令队列，这个在UFS规范里面没有定义，需要UFS器件厂家自己实现。

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